CXL 4.0規(guī)范發(fā)布,采用PCIe 7.0技術(shù)將鏈路帶寬提升至128GT/s,相比前代翻倍。新增原生x2寬度概念、捆綁端口和4個重定時器支持,可將鏈路距離擴展至多機架配置。該技術(shù)針對多機架AI服務器需求,通過PCIe總線實現(xiàn)內(nèi)存池共享連接。支持GPU高帶寬內(nèi)存作為Type 2設(shè)備與主機處理器共享內(nèi)存空間,預計2026-2027年實現(xiàn)商用部署。
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